我們所稱64位元CPU之64 位元是指：
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A. 位址匯流排寬度45.5% (10) -
B. CPU中斷向量的寬度13.6% (3)
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C. 資料匯流排寬度36.4% (8)
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D. 狀態旗標的位元數4.5% (1)
解說:
我們所稱的 64 位元 CPU 中的 「64 位元」，主要是指 CPU 可同時處理的資料寬度或暫存器的大小。
正確答案是：(C) 資料匯流排寬度
詳細說明：
64 位元 CPU 是指 CPU 的暫存器、算術邏輯單元（ALU）和資料匯流排的寬度為 64 位元，這意味著：可一次處理 64 位元的資料,
64 位元 CPU 是指 CPU 的暫存器、算術邏輯單元（ALU）和資料匯流排的寬度為 64 位元，這意味著：可一次處理 64 位元的資料,
支援 64 位元的記憶體位址（可理論存取的記憶體空間遠大於 32 位元）
答對率 : 36.4 %
在程式執行的過程中，微算機處理器 (microprocessor)用那一個元件來儲存下一個指令的位址？
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A. 記億體位址暫存器 (memory address register)4.5% (1)
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B. 指令暫存器 (instruction register)4.5% (1)
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C. 記億體緩衝暫存器 (memory buffer register)0% (0)
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D. 程式計數器 (program counter)90.9% (20)
解說:
在程式執行的過程中，微處理器用來儲存下一個要執行指令的位址的是：
正確答案是：(D) 程式計數器 (Program Counter, PC)
說明：
(A) 記憶體位址暫存器 (MAR):
暫時儲存欲存取記憶體的位址，但不是控制下一條指令的來源。
(B) 指令暫存器 (IR):
儲存目前正在執行中的指令本身，不是位址來源。
(C) 記憶體緩衝暫存器 (MBR 或 MDR):
暫存從記憶體中讀出或要寫入的資料，與指令位址無關。
答對率 : 90.9 %
有一種改進CPU 效能的技術，是同時處理多個指令的擷取(fetch)、解碼(decode)、執行(execute)各步驟，就是前面指令開始解碼時就可開始抓取下一指令，這種技術叫做：
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A. 緩衝(buffering)0% (0)
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B. 重疊(overlapping)0% (0)
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C. 串接(cascading)4.5% (1)
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D. 管線(pipelining)95.5% (21)
解說:
這題是在描述一種可以提升 CPU 效能的技術，具體方式是讓 多條指令的不同執行階段（擷取、解碼、執行）同時並行處理。
正確答案是：(D) 管線（pipelining）
其他選項說明：
(A) 緩衝（buffering）: 用於暫存資料或指令，避免資料等待，但不是主動並行處理的技術。
(B) 重疊（overlapping）: 是 pipelining 的概念之一，但不是技術名稱。
(C) 串接（cascading）: 常指訊號或電路的串聯，與多指令同時處理無直接關係。
答對率 : 95.5 %
下列有關電腦硬體架構的敘述何者錯誤？
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A. 螢幕、喇叭、繪圖機均屬於輸出單元27.3% (6)
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B. 算術邏輯單元執行算數運算及邏輯運算4.5% (1)
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C. 控制單元負責控制、協調中央處理器內各單元的動作及單元間的相互運作0% (0)
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D. 記憶單元和控制單元合稱為中央處理單元68.2% (15)
解說:
選項說明
(A)螢幕、喇叭、繪圖機均屬於輸出單元:
正確, 都是將資料「輸出」給使用者的裝置。
(B)算術邏輯單元執行算術運算及邏輯運算:
正確, ALU（Arithmetic Logic Unit）就是做這兩種運算的核心單元。
(C)控制單元負責控制與協調 CPU 內各單元的動作:
正確, 控制單元指揮 ALU、暫存器等的工作流程。
(D)記憶單元和控制單元合稱為中央處理單元:
錯誤, 中央處理單元（CPU）= 控制單元 + 算術邏輯單元（ALU），記憶單元是屬於主記憶體，不是 CPU 的一部分。
答對率 : 68.2 %
欲定址128K 的位址，至少需要使用多少位址線？
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A. 1781.8% (18)
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B. 1813.6% (3)
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C. 194.5% (1)
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D. 200% (0)
解說:
計算所需的位址線數：
128K 位址 表示的是 128 * 1024 個記憶體位置，也就是 131,072 個位址。
為了能夠對這 131,072 個位址進行編址，我們需要計算所需的位址線數，即所需的位址總數應該是多少位元。
計算過程：
假設我們需要 n 位元來表示每個位址，則可以表示的最大位址數量是：
2^n=131,0722
解此方程式：
n=log2(131,072)=17
所以，至少需要 17 根位址線來定址 128K 的記憶體。
正確答案是：(A) 17
答對率 : 81.8 %